N76E003AT20引脚图

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数字电子技术课程设计 - 标题：数字时钟的设计和生产学期：

专业类：

学号：姓名：

教师和职称：讲师74hc00引脚图。

时间：设计74ls00引脚图及功能表。

熟悉IC引脚布置。 74ls283引脚图及功能。

把握逻辑功能和使用每个芯片的。 7805引脚图。

理解线路板结构和布线的方法。

理解的组成和数字时钟作品。 lm317引脚图。

熟悉数字时钟的设计和生产设计要求

1、 9013引脚图。

设计规格

在24小时的时间段;

时间，分，秒; lm393引脚图。

当存在校正功能，当小时和分钟，分别以分离的修正，它被校正为标准时间;具有一个78l05引脚图。

报时功能的计数过程中，当时间到达小时计时的哔哔声前五秒; op07引脚图。

为了确保稳定的并且由晶体振荡器定时参考信号设计要求7812引脚图。

lm324引脚图。

2、拉伸电路图（或电路仿真）提供精确的所需的定时表针;. 7912引脚图。

组件和参数选择; 7905引脚图。

电路模拟和调试;

PCB文件并生成打印输出。

3、自行装配和调试，并能发现问题和解决问题的生产要求。

4、编写设计报告写出设计和生产的全过程，伴随着相关的资料和图纸，有经验。

设计原理和一个数字时钟

1、

数字时钟的结构的框图实际上是用于计数一个标准频率（1HZ）计数电路。由于时间的起始计数可能与标准的时间（例如GMT），当它需要增加一个校正电路的电路上保持一致，而1HZ标准时间信号必须准确且稳定的石英晶体通常构成一个数字时钟振荡器电路。图。 3-1一般示出的数字时钟的一个框图。图。 3-1数字时钟晶体振荡器电路

数字时钟晶体振荡器电路的

框图，以提供稳定的和的方波信号32768Hz的行进时间准确的频率能保证数字时钟的精度和稳定性。无论是电子时钟的电子时钟的模拟或数字显示器使用的晶体振荡电路。将1Hz的方波信号的频率，以获得第二计数器，用于计数分频器

⑵分频器电路

分频器电路32768Hz的高频方波信号32768（后）实际上是计数器。由第二时间计数电路和第二10位计数器，在时间和点10位的计数器，并且当10计数器电路的位点，并且其中所述第二第二10位计数器，和子

时间计数器电路子10位计数器60是一个二进制计数器，根据设计要求，并且当10位计数器12是一个二进制计数器的时间。 bt136引脚图。

⑷解码器驱动器电路N76E003AT20引脚图

解码器驱动器电路8421BCD代码到计数器输出的所需的数字逻辑状态，并确保所述数字控制提及的正常运行足够的工作电流。

⑸数字数字

通常LED的发光二极管（LED）和液晶数字（LCD），本发明的设计提供了一种用于数字LED。

2、数字时钟

工作。 1）

晶体振荡器晶体振荡器电路形式的数字时钟的核心，旅行时钟确保精确和稳定。图

电路。 3-2由CMOS NAND门输出的方波构成的数字晶体振荡电路，该电路中，CMOS NAND门U1和晶体中，构成晶体振荡器电路的电容和电阻，U2实现整形功能，类似于正弦波振荡器的输出波形转换反馈电阻R1门的输出用于偏置的非理想矩形波，该电路在放大区域中操作，即，类似于高增益反相放大器的NAND门的功能。电容器C1、C2构成的谐振型晶体网络，振荡频率的完全控制，同时提供了180度相移，并由此构成了一个与非门正反馈网络，振荡器的功能。因为晶体具有高频稳定性和精度，以便确保稳定和精确的输出频率。晶体XTAL优选32768HZ的频率lm358引脚图。

。设计用于元件的设计，其频率低，所述数字时钟电路有助于降低频率除法器级。

从在相关手册，这是可在C1、C2是30pF的。当所要求的精度和较高的频率稳定度，并且可以采取接入校正电容器温度补偿的措施。

由于CMOS电路的高输入阻抗，反馈电阻R 1为任选10MΩ。高反馈电阻增加振荡频率的稳定性。 9014引脚图。

非门电路74HC00可选。 7915引脚图。

图3-2 COMS晶体振荡器

2）分频通常

电路，数字时钟晶体振荡器的输出频率较高，以便获得1Hz的第二信号输入端，需要对振荡器输出信号频率-dividing。

除法器电路典型地被实现计数器电路，一般多级二进制计数器实现。例如，32768（215）的振荡信号分频的32768Hz的频分多1HZ，即实现对应于二进制计数器电极的分频计数器15的功能。常见的74HC393二进制计数器等所具有的。 数码管引脚图。

在实验CD4060分频电路用于构成.CD4060数字集成电路可以在分频的最大数量来实现，但需要CD4060振荡器电路还包括使用更方便的一个与非门。二进制计数器14的

CD4060计数，该信号可以是分频32768HZ 2HZ，这在图3-3所示的内部框图，它可以被从图中可见，该时钟输入端串联连接的CD4060两个与非门，可以直接实现振荡频率和子功能。 3-3 CD4046内部块

555芯片引脚图及功能。

图3）将时间计数单元计数时间单独

元有时几个部分计数，秒和分计数装置计数的时间计数通常是

计数器二进制计数器12、如果有两个8421BCD形式的输出代码;分计数手段和第二计数的二进制计数器60、其输出是8421BCD代码。

74HC390二进制计数器10通常用于实现时间计数装置计数功能。减少部件，可选74HC390的数量，在图2、3示出其​​内部逻辑图。该设备是双2- -5-10异步计数器和计数器各自是异步清零端（高电平有效）。 （1/2）所示555引脚图。

内部逻辑图。 3-4 74HC390

第二位计数单元10的二进制计数器，无需二进制转换，简单地QA和CPB（下降沿）被连接到.CPA（减少没有影响），耦合到第二输入信号1HZ，Q3向上作为进位信号和10计数单元连接CPA。 引脚图。

10秒计数单元是6进计数器，二进制转换所需。转换二进制计数器10是在图3-5中所示的6进制计数器电路连接的方法，其中Q 2为上升信号，并分成位CPA计数单元被连接。图3-5

--6十进制计数器二进制位转换电路和子子引脚。

10计数单元和第二电路配置中，分别位和第二10计数单元是相同的，但点Q3位的计数单元应该被连接到子10 CPA计数单元作为进位信号向上，在十个位Q2计数单元也应当该位被连接到计数单元CPA的进位信号向上。当的仍然的电路结构和第二位计数单元或相同的，但需要时，整个单元应该计数的二进制计数器12

位计数单元不是10的整数倍，则所需的比特和十个计数单元可以是结合成一个整体12二进制转换。 74HC390 12使用用于实现在图3-6中示出的功能的二进制计数电路。

另外，图3-6所示的电路外，其余-2进制计数装置的输出信号一样2HZ 1HZ由分频器转换为信号。

图3-612二进制计数器电路

4）和解码驱动

计数器显示单元实现的累积输出时间代码8421BCD形式，计数器电路输出逻辑转换和数字恒定电流的选择的显示的解码器输出码所需的显示装置，显示选择CD4511解码器电路，选择作为显示LED数字时间需要纠正出现错误的单元电路电位器三个引脚怎么接。

n76e003at20制作的电压检测电路不知何故测量数据常...

时。 5）

校正电路，当电源或掉电再次典型地，该时间校正方法是：先断开正常计数通道，然后到人工输入触发计数或更高频率的方波信号施加到所述计数单元对被校正，校正完成，然后转移到正常的计时状态。

请求，数字时钟BRANCH，并应具有正的校正功能，因此，应切断直接计数位和通过点时的比特，使用正常的电路和定时信号的修正信号可以在任何时间访问于此被切换。图。 3-7是当结合图的基本，

校正电路的RS触发器电路的校正。 3-7具有抖动消除电路

磬电路通常包括磬时钟电路应有的功能，即，时间的整点发生在几秒之前，数字时钟自动广播，提醒显示其作用模式是发射连续的或有节奏的音频声波，也可以是更复杂的实时语音提示。

请求，电路磬应该在10秒内开始的时间之前，即，当59分钟，在这段时间50秒到59分59秒，从计时电路74HC30选定定时器电路计时控制信号，从所选择的电声装置是一个蜂鸣器。 1、在

5V电源所需的实验设备。

面包板。

示波器。

万用表。

镊子。

剪刀。

网络线路2米/人。

八数码公共阴极6、

CD4511歧管6

CD4060的歧管。

74HC390歧管3

74HC51的集成块1

74HC00歧管5、

74HC30的歧管。

10MΩ电阻5

500Ω电阻14

30p的电容器2

32、768时钟晶体ķ。

蜂鸣器。

2、芯片和引脚配置图，图的图图

4-17400四个2输入与非门的内部。 4-2 CD4511BCD七段译码器/图4-3 CD4060BD驱动

图4-4 74HC390D

图4-5 74HC51D 4-6 74HC30

3中试验板上通信五组，垂直面包板的右侧

内部结构纵连五组，左垂直试验板分成四组，每一组X，Y柱（0-15通信，通信16-40、41-55相通，ABCDE通信，通信FGHIJ，E和F的未进行通信的确实

之间。示出的功能块和CD4511数字LED驱动电路的电路图连接到从0 --- 9显示以次一个CD4511、数字控制检查数字控制的质量，参见图5-1、

图5-14511

使用数字的LED驱动电路，所述CD4511、一个74HC390、从0- 9示出了数字控制振荡器的作用下连接到十进制计数器电路的74HC00、参见图5-2、图

5-274390使用十进制计数器

数字LED，一个的CD4511、一个74HC390、一个74 HC00是康涅狄格州从0-6 ected于晶体和十六进制计数器，数字显示，参见图5-3、图

利用十六进制计数器电路和一个十六进制5-374390

连接到十进制六十进制电路，显示电路从0-59、参见图5-4、图。使用两个电路六十进制一个双六个十进制合成电路，两个六个十进制进位之间5-4

六十进制

电路，参见图5-5 5-5双

六十进制

使用CD4060电路，和一个连接到除法器晶体电阻 - 晶体振荡器电路，参见图5、 -6

图分频器5-6 - 使用电阻器和74HC51D 74HC00和连接到所述时间校正电路

晶体振荡电路，参见图5-7参考5-7

校正电路时 使用双74HC30六十进制和当十二进制连接的蜂鸣器连接磬电路。参见图5-8、图。 5-8

使用，点，第二电路将携带的一般视图，参见图5-9、

图5-9、图进位的连接点，所述第二求和点

示意性布局元件，参照图6-1

芯片连接图看到在设计中遇到图7-1

8总结

问题过程和他们的解决方案。该过程的

检测线路板状态，这个地方的外观，但相互关联的情况没有通过，是经过。

发现通过检查发现，由于万用表面包板检测CD4511数字驱动器电路不正常状态期间不垂直于在与动作的内部接触的笔尖，该测试主要是由于接触发现故障的问题，包括接触不良和芯片线的接触不良，在实验过程中，与一对夫妇数字控制的消失二极管，有时会消失。数字检测管，一端接地，另一端用5V电源的接触二极管的每一部分中，二极管可以在通常显示中找到，然后检测是否每个万用表欧姆导线接触良好，已发现，在检测过程中有时可以在几行转动时，可以不被接通，重新获取发现法线节目之后的接触不良随后芯片由于用万用表欧姆接触不良的问题根据本通过本地通信和没有被检测几个销在良好的条件的检测电线，其为溶液CD4511芯片除去，重新调整所述销根据面包板孔的状态，以使正空穴，然后被迫均匀地电镀所述芯片到面包，之后发现是正常的，这个实验还发现，一个糟糕的数字LED和CD4511两个坏，更换后可正确显示。晶体的连接期间

，晶体不能振动。芯片的接触不良问题和线控制电路图排除再次，发现由于销12不接地动作。十六进制的连接期间

发现只有4,5电路的跳动，之后发现是由于非销被连接到所述门的误动作，之后可以正常显示的校正。校正电路的连接，和所述校正点的事件期间

时间可以是正常的，但第二已经影响，特别是当一个相对分钟时，第2反射而不进行校正时的时间，为40秒至59跳，然后跳回40、搬入以分和秒，在电路中，分，秒通常显示时携带，也可以是差触点和负极芯片连接之间。经检验，没有误差校正电路连接，与充电直流电压档后万用表检测10秒QA，QB，QC和QD脚，脚发现电压QA当再次检测没有电压时被分配给第二个进位端子和发现是由于第二次进不拔的动作。在生产过程中

计时电路，发现57分钟蜂鸣器59秒的时候就开始撞击，检测电路被发现后，由于销16当芯片74HC30芯片接合，以及连接错位，再布线正常计时。

分压电路连接，当所述一个当位QD和十英尺关断，然后当一只脚丈3晶体，当10管脚3至引脚第二位的1时，连接的电路图不起作用，10当从0-9跳，当0比特只能显示，在分频电路3个使用两只脚，它是不正常的，并因此使74HC390分频电路的二进制逻辑12空出来，所以地面CD451112、6英尺十比特，所述销7与74HC390的销5、74HC390 3,4脚断，和4英尺到9英尺即可以，其中腾空74HC3903英尺然后可用于分割2HZ，分频后的1Hz，则此整个电路也算作一个普通的数字时钟。

2、本设计经验

数字时钟设计过程中，进一步熟悉了芯片的结构，掌握芯片和它的具体使用的工作原理。

在连接十六进制，十进制，六十进制和法律后10进位的二进制访问需要具有逻辑和每个销芯片的功能的熟悉程度，它能够准确判断误差在电路和纠正错误。

在电路设计，模拟连接往往是第一物理图谱，及一个电路仿真连接，但有时是不完全一致，例如，模拟的连接图中，常常不采取16英尺高电平或14英尺然后低引脚7或8脚，所以在实际电路连接往往容易错过另一个示例74HC390芯片，其本身是一个十进制计数器，必须连接到反馈线向模拟电路正常地显示，并且在实际电路不再连接，因此模拟图和电路连接图仍然有些差异的主要原因

误差在连接图中的电路的设计是不好的和错误的布线和布线芯片造成的。

3、设计方案

数字时钟设计和仿真的重布线，尽管该电路可以图分出，并显示出，但电路的原理本身并不是很熟悉。总之，通过本实验旨在进一步提高实验的能力。

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